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首页 >> 毕业论文(设计) >> 计算机毕业论文(设计) >> 武汉理工大学EDA课程设计 序列信号检测器
武汉理工大学EDA课程设计 序列信号检测器
资料类别
   计算机毕业论文(设计)
课程(专业)
  EDA
关键词
  VHDL|序列信号检测器
适用年级
  大学
身份要求
  普通会员
金 币
  40  (金币如何获得?

文件格式

  word
文件大小
  108K
发布时间
  2010-05-06 21:10:00
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下载次数
  2
发布人   zxx010
 内容简介:     武汉理工大学EDA课程设计 序列信号检测器 共19页,5151字。
   摘 要
   本文介绍了一种采用单片CPLD芯片进行序列信号检测器的设计方法,主要阐述如何使用新兴的EDA器件取代传统的电子设计方法,利用CPLD的可编程性,简洁而又多变的设计方法,缩短了研发周期,同时使出租车计费器体积更小功能更强大。本设计实现了序列检测器所需的一些基本功能,包括检测序列、输出报警,更注重了把一些新的思路加入到设计中。主要包括采用了CPLD芯片,使用VHDL语言进行编程,使其具有了更强的移植性,更加利于产品升级。
   关键词:VHDL;序列信号检测器;QuartusⅡ;CPLD
  
   目 录
   摘 要 I
   Abstract II
   1 绪论 1
   2 设计内容及要求 2
   2.1设计的目的及主要任务 2
   2.1.1设计的目的 2
   2.1.2 设计任务及主要技术指标 2
   2.2设计思想 2
   3 QuartusⅡ及VHDL语言简介 3
   4 设计原理及模块设计 5
   4.1 设计原理 5
   4.2模块设计 6
   4.2.1状态转换模块 6
   4.2.2 输出控制模块 7
   4.3总体电路的设计 7
   5电路的仿真及分析 8
   6心得体会 9
   参考文献 10
   附录 11

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